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元スレIntelの次世代CPUについて語ろう 43

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951 : Socket77 - 2010/09/22(水) 19:02:48 ID:J5fisNyc (+24,+29,-2)

ミラーリングじゃないんだからいちいちこっちに転載しなくてよろしい

953 : Socket77 - 2010/09/22(水) 19:17:46 ID:lY799X1p (-25,-30,-109)

Socket774：2010/09/22(水) 18:42:15 ID:y8jeeMgE
> Zacate
>

13.3インチノートで左2.5インチHDDの上にDVDドライブ付けて
win98時代ノートみたいな分厚さで、
売ってくれても、買う人が居ないんだな。

手の平サイズメインボードとシンクファン無しCPU/APU作ってくれたら、
メーカーが発展させてくれるんだろうけど・・・・。

13インチ　背高シンク　ファン絶対死守。
CPU周り　メインチップ周りの空き地絶対必要みたいなの作って、
os　ウイン7すら操作重。
これで、どう売れと。

初っ端でいきなり凄い限界露呈ぶりだな。

Llano　ブルドーザーに期待!!

955 : Socket77 - 2010/09/22(水) 19:55:38 ID:dIxP6NpM (+19,+29,-4)

どうみてもID変えた本人ですｗ

957 : Socket77 - 2010/09/22(水) 21:47:12 ID:bmHBSGPW (+24,+29,-12)

Intelの場合は、「トリック」ってのをスノボとかその辺の意味合いで使うのか。

958 : Socket77 - 2010/09/22(水) 21:51:03 ID:ZRAtvZUX (+20,+29,-4)

>>233
けいおんなんてエロ同人以外には価値無いだろ（ｷﾘｯ

960 : Socket77 - 2010/09/22(水) 22:42:37 ID:k+9BfawU (+14,+24,-2)

誤爆しまして、すまん？

961 : Socket77 - 2010/09/23(木) 01:44:50 ID:Gu0v3KWi (+17,+27,-2)

ミラーリングわろた

962 : Socket77 - 2010/09/24(金) 07:41:34 ID:xw/41qFD (-25,-30,+0)

Socket774：2010/09/24(金) 01:33:44 ID:rIgCgld/
液晶サイズ：13.1インチ
CPU：Core i5 520M/2.4GHz(512KB)
メモリ容量：4GB
OS：Windows 7 Home Premium
Windowsエクスペリエンス・インデックス
CPU　　　　 6.7
memory 5.9
graph 6.3
game graph 6.3
SSD 7.3

快適目安のすべて5以上であることがわかった。
この使用感はいいんだろうな。
http://www.vaio.sony.co.jp/vaio/products/Z11/index.html

次に来年出る恥ずかしいAPUノートブックのWindowsエクスペリエンスを予想
メモリー SSD OSは全く同じもの

液晶サイズ：13.1インチ
CPU：ATIライダー　Zacate/1.6GHz×2
メモリ容量：4GB
OS：Windows 7 Home Premium
Windowsエクスペリエンス・インデックス
Zacate
CPU　 3.1 (ATOM 330（デュアルコア）3.6)Core i5 520Mノート　6.7
memory 4.1 (ATOM 330（デュアルコア）4.7)Core i5 520Mノート　5.9　　
graph 3.2 (ATOM 330 オンボNVIDIA ION 4.7) Core i5 520Mノート　6.3　
game graph 5.4 (ATOM 330 オンボNVIDIA ION 5.3) Core i5 520Mノート　6.3
SSD 5.3 ←例のamd落ちの奴の影響で

こんな感じになりそう。

970 : Socket77 - 2010/09/25(土) 07:48:20 ID:gXiMEg11 (+9,+29,+0)

>>968
卑怯だなほんと卑怯だわ

974 : Socket77 - 2010/09/26(日) 16:24:58 ID:Eo3BXjOg (+17,+22,-31)

sandyのハードウェアトランスコーダ
結構API用意されてんだな。
おまけ程度の機能でビットレートぐらいしか指定できないと思っていた

975 : Socket77 - 2010/09/26(日) 16:51:13 ID:tWNtJz2m (+3,+4,-40)

なんでモバイル系のＡＭＤＣＰＵスレになってるんだ　うぜえええ

976 : Socket77 - 2010/09/26(日) 17:16:44 ID:eic2pFCo (+22,+29,-2)

たるさんすげえな

979 : Socket77 - 2010/09/26(日) 18:23:57 ID:AtaLKdXL (+18,+28,-13)

>>975
蒸し返すなｗ

980 : Socket77 - 2010/09/26(日) 18:47:59 ID:q0/kSuII (+12,+11,-15)

>>976
トレースキャッシュとuOpキャッシュを混同してるので滅茶苦茶な記事になってるな
SandyのはあくまでuOpキャッシュであってトレースキャッシュではない

981 : Socket77 - 2010/09/26(日) 18:55:47 ID:aa4ablhL (+32,+29,-40)

混同はしてないんじゃないの？
トレースキャッシュの弱点を知っているから、SandyBridgeでのμopsキャッシュを利用した
分岐予測技術はIntelに一日の長があるってことを言いたいんじゃないんだろうか。

983 : Socket77 - 2010/09/26(日) 21:51:18 ID:SXKJ/usC (+29,+29,-46)

intel的には、「トレースキャッシュ」と言ってしまうことで、大失敗のPen4の再来を予感させて買い渋られてしまうのを避けたいってのが大きいんじゃないの
秘伝のタレを除けば、マイクロopのキャッシュという点でどっちも同じ

984 : Socket77 - 2010/09/26(日) 22:38:08 ID:q0/kSuII (+28,+29,-118)

いやいや
トレースキャッシュはあくまでも分岐を跨いだ命令列を同一のキャッシュラインに格納して、
キャッシュアクセスあたりの命令供給数を通常のI$より増やすのが本来の存在意義だよ。
別にデコーダの前に置いたってトレースキャッシュはトレースキャッシュ。
x86の実装上、トレースキャッシュをデコーダの後に置けば内部命令の変換キャッシュにもなって
むしろそちらとしての機能のほうが性能への寄与が大きいっぽいというだけの話。

985 : Socket77 - 2010/09/26(日) 22:47:03 ID:q0/kSuII (+27,+29,-17)

デコーダの前というのは語弊があるな
uOpへの変換前と訂正しておこう

986 : Socket77 - 2010/09/26(日) 23:00:33 ID:aa4ablhL (+33,+29,-18)

>>984
ああ、そういう意味だと俺も混同してた。
あの文脈だとネトバのトレースキャッシュのことだから、μopsの命令列でって
当然の前提で読んでたし。

989 : Socket77 - 2010/09/27(月) 00:50:45 ID:ycUR4HZa (+22,+27,-9)

沖電気もAtomのチプセト作るのかｗｗｗ
IPFの時なんかやってたっけ？くらいの記憶しかねーｗ

992 : Socket77 - 2010/09/27(月) 03:59:43 ID:LZooQF/g (+20,+29,-80)

>>991
違うって。単にIntelのPen4における実装で
トレースキャッシュはuopキャッシュの役割も果たしているというだけ。

本来は命令をアドレス順ではなく実行順にキャッシュラインに入れて
分岐した時にキャッシュラインへのアクセスがバラバラになるのを防ぐ技術。

993 : Socket77 - 2010/09/27(月) 04:06:10 ID:OJGf5Q8j (+29,+29,-37)

http://journal.mycom.co.jp/articles/2010/09/25/idf09/index.html
> このL0キャッシュは、単なるキャッシュではなく、分岐した場合に命令を
> つなぎ合わせることが可能で、いわゆるトレースキャッシュである。

分岐先を管理しているなら何でもトレースキャッシュと言うべきか否か

994 : Socket77 - 2010/09/27(月) 05:03:36 ID:w3ivBzDG (+28,+23,-68)

トレースキャッシュは実装の名前だね
Pen4は他にもNetBurstなるユニークな名前を持ってるし

Pen4でまずかったのは、
・μOpバッファを1次命令キャッシュの代わりとして使ったこと
・デコーダの同時解釈数を1命令に下げたこと

Sandyでは、
ちゃんと1次命令キャッシュと強力なデコーダを持った上で
μOpバッファを追加してるから、
最小限のデメリットで最大限の効果が期待できる

995 : Socket77 - 2010/09/27(月) 06:33:03 ID:N1GAKs6V (-15,+30,-276)

なるほどやっと言いたいことが分かってきた。
980の主張は、トレースキャッシュは本来命令を分岐予測に従って並べ替えることで、uOPsの変換は関係ない、ということか。
http://journal.mycom.co.jp/column/architecture/178/index.html
恥ずかしながら知らなかった。e-Wordsの説明は間違っていることになるｗ
たるさんの記事は、トレースキャッシュ(本来並べ替えた命令のキャッシュ)＝uOPsキャッシュ(並び替えないキャッシュ)と「混同している」からおかしいと。

ただ、これが正しいとしても、たるさん記事が根本的にひっくり返るかといえば微妙だと思う。
秘伝のたれは分岐予測技術にある、トランジスタ効率が低いトレースキャッシュの欠点が解消された、という結論には影響しないわけで、
ところどころ意味不明な文章があるものの、そこまで「支離滅裂」だとはあまり思えない。GPUやクラウドの話には異論無いんだよね？

そもそもたるさんは昔からNetBurstのトレースキャッシュをuOPsキャッシュとしてしか見ていないと思う。
http://www.ne.jp/asahi/comp/tarusan/main11.htm
この諸刃の剣シリーズの記事でも、トレースキャッシュの話の中心は明らかに分岐予測ではなくuOPsキャッシュの話だし。
もしかして、命令を並べ替えることでキャッシュラインを行ったり来たりしなくなって速くなる、という利点をあえて無視してるんじゃない？
(984も言ってるけど)そんなことよりx86命令のデコーダの負荷軽減の方がはるかに?高速化に一役買ってるだろーって。考えすぎ？

次スレ立ててみる

997 : Socket77 - 2010/09/27(月) 06:41:54 ID:ByIQRXxJ (+17,+29,+1)

たるさんとか
どうでもいい

998 : Socket77 - 2010/09/27(月) 14:10:06 ID:JR7isX/I (+28,+29,-19)

>>994
実装の名前じゃないよ...
「トレース」キャッシュだ。概念の名前

999 : Socket77 - 2010/09/27(月) 16:54:57 ID:Hz4Qzg0Z (+10,+25,+0)

うめちゃえ

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