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元スレメモリはやっぱりECC Part7
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メインストリームでECC使わせてくれればすぐにでもIntelへ戻るんだがなぁ
>>506
エラー率も変わらないのですかね?
エラー率も変わらないのですかね?
>>506
無知ですまんが
オンダイECCはセル内部のみのエラーを修正する。コントローラとモジュール間のエラーは修正できない
みたいなこと書いてるけど、普段出るエラーはコントローラとモジュール間が多いから意味無いってこと?
無知ですまんが
オンダイECCはセル内部のみのエラーを修正する。コントローラとモジュール間のエラーは修正できない
みたいなこと書いてるけど、普段出るエラーはコントローラとモジュール間が多いから意味無いってこと?
>>510
それ本当?Googleソフトエラー(宇宙線)って言ってたような気がするのだけど
経路が劣化するのも初めて聞いた。接点が劣化するのは経験したが差し直せば治る。
宇宙線が殆どならばオンダイECCで殆ど解決出来るだろうと期待してたけど
経路が劣化するなら、コントローラーとモジュール間のECCが必要と喧伝するのも分かるけど、、、
それ本当?Googleソフトエラー(宇宙線)って言ってたような気がするのだけど
経路が劣化するのも初めて聞いた。接点が劣化するのは経験したが差し直せば治る。
宇宙線が殆どならばオンダイECCで殆ど解決出来るだろうと期待してたけど
経路が劣化するなら、コントローラーとモジュール間のECCが必要と喧伝するのも分かるけど、、、
信頼性を上げるために追加された機能でなくて
今までと同じ品質を確保するために追加された機能なのよ
フラッシュメモリとかMLC→TLC→QLCと進むごとにどんどんデータ壊れまくるようになって
それじゃ困るから実用製品にするためにエラー訂正どんどん山盛りにしてるけどそれと同じ
今までと同じ品質を確保するために追加された機能なのよ
フラッシュメモリとかMLC→TLC→QLCと進むごとにどんどんデータ壊れまくるようになって
それじゃ困るから実用製品にするためにエラー訂正どんどん山盛りにしてるけどそれと同じ
>>511
信号のエラー訂正が貧弱だったDDR3までと
CRC符号で信号のチェックするDDR4で
落ちる頻度がだいぶ変わっただろ?
宇宙線でのビット反転の頻度が経年で変わるわけはない
単純にホコリや湿気・端子や回路の酸化・電源の劣化の総合的な老化
信号のエラー訂正が貧弱だったDDR3までと
CRC符号で信号のチェックするDDR4で
落ちる頻度がだいぶ変わっただろ?
宇宙線でのビット反転の頻度が経年で変わるわけはない
単純にホコリや湿気・端子や回路の酸化・電源の劣化の総合的な老化
というか他にも
DDR4では命令にパリティビットが付くようになったりと
良い感じに広帯域のバスへの安全策が盛り込まれてる
DDR4では命令にパリティビットが付くようになったりと
良い感じに広帯域のバスへの安全策が盛り込まれてる
>>520
ぶっちゃけ使わなくても現行世代並みの信頼性確保できるなら無駄なコスト費やして実装する意味ないんじゃね?
ぶっちゃけ使わなくても現行世代並みの信頼性確保できるなら無駄なコスト費やして実装する意味ないんじゃね?
>>521
それやっておみくじ状態になったDDR3と同じ轍を踏まないといいが・・・
それやっておみくじ状態になったDDR3と同じ轍を踏まないといいが・・・
オンダイECCはその名の通りシステムからは操作できない
レジスタードとアンレジってクロックタイミング合わせてるかだけで
ECCとしての信用性とかって別に変わらないのよね?
ECCとしての信用性とかって別に変わらないのよね?
実装によるところが大きいけど
遅延と最大容量以外は変わらないはず
安物のレジだと悪化してるかもしれんが
わざわざそんなメモリ作るメーカーだと
アンバッファでもやらかすからメーカー大事
遅延と最大容量以外は変わらないはず
安物のレジだと悪化してるかもしれんが
わざわざそんなメモリ作るメーカーだと
アンバッファでもやらかすからメーカー大事
レジスタードの大容量メモリが必要な環境でECCが不要なことが極めて稀だからECCも付いてるだけで技術としてはお互い関係ない
経路でエラー起こすこともある。(どっちかというと回路設計ミスったような場合のようなきもするけど。)
CPUの中のキャッシュ回路との間でエラー出まくりで困ったという事例がその昔あって、
日本の某メーカーの人がアメリカの会社までいって調査して大変だったという話を聞いたが、
エラー訂正いれるにはキャッシュだと遅くなりすぎのような気もするし、どうしたのだろう?
CPUの中のキャッシュ回路との間でエラー出まくりで困ったという事例がその昔あって、
日本の某メーカーの人がアメリカの会社までいって調査して大変だったという話を聞いたが、
エラー訂正いれるにはキャッシュだと遅くなりすぎのような気もするし、どうしたのだろう?
>> 556
> eccメモリをOCしたときにL3のECCエラーが返ってきたから
> Ryzenはパリティチェックをキャッシュ内でやってるんでないかと思ってる
555 です。
その昔、AMDが高速のCPUといってキャッシュメモリとCPU本体がパッケージの中には入ってるけど、実は
別々のダイに入ってるような小さな弁当箱のようなパッケージを出したことがあったけども、
それをみた当時のDECとかコンピュータメーカーの設計者が、CPUとキャッシュの間にエラー検出の冗長ビットがないと
いって呆れていたことがあったけど、少なくともAMDは学習したというか、そういうコンピュータメーカーのエンジニアもAMDの設計段階ではいるようになったというか、
時代の要請なんでしょうねえ。COTの製品でスーパーコンピュータ作るようになったら必須であると。
(昔の「京」を作った富士通の人のCPUの機能の歴史的比較を入れた説明文書よんでたら、その点INTELはちょっと遅れてるような気がした。)
まあ、家のPCにECC使ってるのはこのスレッド読んでるような人達くらいしかいないのだろうけども。
もう少し工学の計算やってる人たちとかたまに起こるメモリエラーに敏感になってよいような気がする。
> eccメモリをOCしたときにL3のECCエラーが返ってきたから
> Ryzenはパリティチェックをキャッシュ内でやってるんでないかと思ってる
555 です。
その昔、AMDが高速のCPUといってキャッシュメモリとCPU本体がパッケージの中には入ってるけど、実は
別々のダイに入ってるような小さな弁当箱のようなパッケージを出したことがあったけども、
それをみた当時のDECとかコンピュータメーカーの設計者が、CPUとキャッシュの間にエラー検出の冗長ビットがないと
いって呆れていたことがあったけど、少なくともAMDは学習したというか、そういうコンピュータメーカーのエンジニアもAMDの設計段階ではいるようになったというか、
時代の要請なんでしょうねえ。COTの製品でスーパーコンピュータ作るようになったら必須であると。
(昔の「京」を作った富士通の人のCPUの機能の歴史的比較を入れた説明文書よんでたら、その点INTELはちょっと遅れてるような気がした。)
まあ、家のPCにECC使ってるのはこのスレッド読んでるような人達くらいしかいないのだろうけども。
もう少し工学の計算やってる人たちとかたまに起こるメモリエラーに敏感になってよいような気がする。
intelメインストリームはECCが使えないから、Ryzenにしたのに、今更対応とかね~よな。
リーナスに怒られたから、対応すんのか?
リーナスに怒られたから、対応すんのか?
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